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didattica:triennale:architettura:ay_1516:main [2016/03/01 13:15]
indrit [Contenuti del Corso]
— (current)
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-====== Teoria Architettura degli Elabotatori ====== 
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-===== News ===== 
-<WRAP center round important 95%> 
-  * <wrap em>**25 Febbraio 2016**</​wrap>:​ La pagina del corso è on-line ​ 
-</​WRAP>​ 
  
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-===== Informazioni Generali ===== 
-<WRAP box round 95% center> 
-**Docente**: ​ 
-  * [[http://​docenti.unicam.it/​pdett.aspx?​ids=N&​tv=d&​UteId=555&​ru=RU|Diletta Romana Cacciagrano]] ​ 
- 
-**Orario delle Lezioni**: 
-  * Martedì 15 - 17 (Aula E. W. Dijkstra) 
-  * Venerdì 11 - 13 (Aula E. W. Dijkstra) 
- 
-**Ricevimento studenti**: 
-  * Su domanda e concordato tramite comunicazione email. 
-</​WRAP>​ 
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-===== Obiettivi del Corso ===== 
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-<WRAP box round 95% center> 
-Comprendere la struttura e il funzionamento di un 
-elaboratore e delle sue diverse parti hardware e software. Conoscere 
-come viene rappresentata e trattata l'​informazione nei sistemi di 
-elaborazione e nei diversi livelli gerarchici di astrazione. 
-Conoscere i principi e le tecniche di programmazione dei sistemi ai 
-vari livelli con particolare enfasi alla macchina firmware e 
-assembler. Focalizzare le principali scelte di progetto delle 
-architetture di sistemi, con particolare riferimento al parallelismo ai 
-diversi livelli. ​ 
- 
-Saper analizzare criticamente,​ sulla base delle conoscenze acquisite nella parte teorica, i componenti dei moderni computer disponibili sul mercato. Acquisire competenze sul funzionamento delle architetture a livelli grazie allo sviluppo di circuiti digitali e semplici programmi che facciano uso di microcontrollori. 
-</​WRAP>​ 
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-===== Contenuti del Corso ===== 
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-<WRAP round 95% center box> 
-- Sistemi a livelli. ​ 
-- Principi di parallelismo e cooperazione (validi a tutti i livelli), prestazioni. 
-- Aritmetica del Calcolatore. 
-- Logica Digitale, Processori, gerarchie di memorie, comunicazioni,​ dispositivi. ​ 
-- Architettura dell'​unità centrale e dei dispositivi di ingresso-uscita. 
-- Memoria a più livelli 
-- Parallelismo a livello di istruzioni. 
-- Multiprocessori e multicalcolatori. 
- 
- 
-- Metodologie e tecniche di progetto (di base) per la 
-realizzazione dei dispositivi di elaborazione digitale. 
-- Macchine digitali e reti logiche. Codifica delle informazioni - principali codici numerici e alfanumerici. Sintesi e ottimizzazione dei circuiti combinatori. 
- 
-- Il concetto di stato nei sistemi digitali. Modelli e metodi di analisi e sintesi delle reti logiche combinatorie e sequenziali. 
-- Reti combinatorie,​ algebra della commutazione,​ i principali componenti combinatori:​ decoder, multiplexer,​ operatori aritmetici, 
-sintesi minima sintesi basata sulle espressioni generali e sui teoremi di espansione. 
- 
-- Reti sequenziali - automi a stati finiti, reti sequenziali asincrone e il FF-SR, reti sequenziali sincrone e il FF-D, reti sequenziali sincrone comunemente impiegate come componenti di sistemi digitali: contatori e registri di vario tipo. 
-- Composizione di contatori, registri e reti combinatorie programmabili. 
-Introduzione all'​architettura di un calcolatore:​ Data Path e Unità di controllo. 
-Componenti programmabili 
-</​WRAP>​ 
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-===== Materiale ===== 
-<WRAP box round center 95%> 
-**Slide del Corso** 
-  *  
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-**Testi di Riferimento** 
-  * William Stallings, "​Architettura e organizzazione dei    calcolatori. Progetto e prestazioni (8ed)",​ Pearson Education Italia, ​   ISBN: 978-8871925974 
- 
-  * Mano M. Morris, Charles R. Kime, "Reti logiche (4ed)",​ Pearson Education Italia, ​   ISBN: 978-8871924618 
-</​WRAP>​ 
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-===== Esami ===== 
-<WRAP box round center 95%> 
-**Date Esami A.A. 2015/2016** 
-  * 1a sessione 
-  * 2a sessione 
-  * 3a sessione 
-  * 4a sessione 
-**Regole di esame**: ​ 
- 
-** Risultati Esame ** 
-  * N/A 
-</​WRAP>​